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24 Treffer: Verilog Jobs in Pirna

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  • Entwicklungsingenieur FPGA (m/w/d)

    Optomet Gmbh
    Dohna
    09.11.2024
    Vollzeit
    Gesundheitsförderung
    Parkplatz
    Flexible Arbeitszeiten
    Weiterbildungsmaßnahmen
    Mitarbeiter-Events
    Sportaktivitäten
    FPGA
    Programmiererfahrung
    Zielorientierung
    Simulink
    Berufserfahrung
    Informatik
    Teamfähigkeit
    Englisch
    Internet Protocol
    VHDL
    Verilog
    Systemintegration
    Kreativität
    Matlab
    Belastbarkeit
    Deutsch

  • Digital Design Engineer

    Fraunhofer-Gesellschaft
    Dresden
    14.03.2025
    Teilzeit
    Sorgfältige Einarbeitung
    Mobiles Arbeiten
    Flexible Arbeitszeiten
    Mitarbeiter-Events
    Raumfahrt
    Zielorientierung
    SystemC
    Anforderungsanalyse
    CAN
    Informatik
    Signalverarbeitung
    Englisch
    Wirtschaft
    TVöD
    Personalabteilung
    Design
    Xilinx
    Berufserfahrung
    Ethernet
    Autonomes Fahren
    Wertschätzung
    Internet Protocol
    Engagement
    Verilog
    Kommunikation
    Elektrotechnik
    Virtual Prototyping
    Kreativität
    LIN
    Deutsch

  • Senior Staff Engineer Analog Mixed Signal Power Management (f/m/d)

    Infineon Technologies AG
    Dresden
    13.03.2025
    Machine Learning
    EDA
    Design
    Customer Success
    Security
    Edge
    Perl
    Internet der Dinge
    Synopsys
    Internet Protocol
    Python
    Spirit
    SAFe
    Hybrid
    Verilog
    Cadence
    IoT
    Engineering

  • Electronic Engineer as Senior Staff Engineer Mixed Signal and IC-Digital verification (f/m/d)

    Infineon Technologies AG
    Dresden
    13.03.2025
    Machine Learning
    EDA
    Design
    Customer Success
    Security
    Edge
    Perl
    Internet der Dinge
    Synopsys
    Internet Protocol
    Python
    Spirit
    SAFe
    Hybrid
    Verilog
    Cadence
    IoT
    Engineering

  • Senior Staff Engineer Microelectronics Mixed-Signal Verification (f/m/d)

    Infineon Technologies AG
    Dresden
    13.03.2025
    Machine Learning
    EDA
    Design
    Customer Success
    Security
    Edge
    Perl
    Internet der Dinge
    Synopsys
    Internet Protocol
    Python
    Spirit
    SAFe
    Hybrid
    Verilog
    Cadence
    IoT
    Engineering

  • Senior Staff Engineer Analog Mixed Signal AI/Machine Learning (f/m/d)

    Infineon Technologies AG
    Dresden
    13.03.2025
    Machine Learning
    EDA
    Design
    Customer Success
    Security
    Edge
    Perl
    Internet der Dinge
    Synopsys
    Internet Protocol
    Python
    Spirit
    SAFe
    Hybrid
    Verilog
    Cadence
    IoT
    Engineering

  • Senior Staff Engineer Analog Mixed Signal Verification (f/m/d)

    Infineon Technologies AG
    Dresden
    13.03.2025
    Machine Learning
    EDA
    Design
    Customer Success
    Security
    Edge
    Perl
    Internet der Dinge
    Synopsys
    Internet Protocol
    Python
    Spirit
    SAFe
    Hybrid
    Verilog
    Cadence
    IoT
    Engineering

  • DFT Architect

    Racyics Gmbh
    Dresden
    08.03.2025
    Vollzeit
    Mitarbeiter-Events
    Design
    Integrity
    Edge
    Programmiererfahrung
    Tcl/TK
    CAN
    Simulation
    Flexibilität
    Synopsys
    Industrial
    VHDL
    Verilog
    Debugging
    Cadence
    Functional Safety
    Engineering

  • Praktikum zur IP-Verifikation und Validierung unter Nutzung virtueller Prototypen (VPs)

    Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e.V.
    Dresden
    08.03.2025
    Vollzeit
    Sorgfältige Einarbeitung
    Raumfahrt
    Design
    SystemC
    C-Programmiersprachen
    Informatik
    Open Source
    Englisch
    Flexibilität
    Validierung
    Internet Protocol
    VHDL
    Wirtschaft
    Verilog
    Elektrotechnik
    Informationstechnik
    Personalabteilung
    LIN
    Deutsch

  • Internship for IP verification and validation under use of virtual prototypes (VPs)

    Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e.V.
    Dresden
    08.02.2025
    Vollzeit
    Framework
    SystemC
    OOD
    Budget
    CAN
    Test Automation
    C-Programmiersprachen
    Simulation
    Origin
    Mobile App
    Flexibilität
    Open Source
    Internet Protocol
    Industrial
    Automated Testing
    VHDL
    HR-Bereich
    Automation Testing
    Verilog
    Support
    LIN
    Engineering

  • Working Student as Digital Design Engineer for Advanced In-Memory Computing

    Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e.V.
    Dresden
    08.02.2025
    Teilzeit
    FPGA
    Design
    Framework
    OOD
    IMC
    Budget
    Tcl/TK
    CAN
    Simulation
    Origin
    Mobile App
    Flexibilität
    Industrial
    VHDL
    HR-Bereich
    Verilog
    Debugging
    ASIC
    Support
    Automatisierung
    Engineering

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    • Werkstudent*in / Studentische Hilfskraft im Bereich Softwareentwicklung

      Fraunhofer-Gesellschaft zur Förderung der angewandten Forschung e.V.
      Dresden
      06.06.2024
      Teilzeit
      Sorgfältige Einarbeitung
      Programmiererfahrung
      Xilinx
      Basic HTML
      Informatik
      Windows
      Flexibilität
      Benutzerschnittstelle
      Java
      Wirtschaft
      Verilog
      Linux
      Personalabteilung
      Deutsch

    • Andere suchten nach

    • Senior Staff Engineer Firmware Verification (f/m/div)

      Infineon Technologies AG
      Döbeln
      26.02.2025
      Vollzeit
      Customer Success
      Security
      Compliance
      ACT!
      Internet der Dinge
      Simulation
      Mobile App
      Automotive SPICE
      Python
      SAFe
      Hybrid
      Solid
      VHDL
      Verilog
      Debugging
      Cadence
      Support
      IoT
      Engineering

    • Senior Staff Engineer Digital Design (f/m/d)

      Infineon Technologies AG
      Döbeln
      26.02.2025
      Vollzeit oder Teilzeit
      Customer Success
      CAN
      Spirit
      SAFe
      Make
      Solid
      Go
      IoT
      Design
      Security
      Edge
      IT
      CPU
      Perl
      Internet der Dinge
      Mobile App
      Internet Protocol
      Python
      Hybrid
      Analyse
      Verilog
      Debugging
      Support
      Functional Safety
      LIN
      Engineering

    • Senior Staff Engineer Circuit Simulator Development (f/m/div)

      Infineon Technologies AG
      Döbeln
      26.02.2025
      Vollzeit
      Customer Success
      Design
      EDA
      Edge
      Programmiererfahrung
      PSpice
      IT
      Internet der Dinge
      Simulation
      Windows
      UNIX
      Mobile App
      Layout
      C++
      SAFe
      Fortran
      Verilog
      DES
      Cadence
      Support
      IoT
      Engineering
      Refactoring

    • Senior Staff Engineer Analog Mixed Signal Verification (f/m/d)

      Infineon Technologies AG
      Döbeln
      26.02.2025
      Vollzeit oder Teilzeit
      Machine Learning
      Customer Success
      Security
      EDA
      Design
      Edge
      Perl
      Internet der Dinge
      Mobile App
      Synopsys
      Spirit
      Internet Protocol
      Python
      SAFe
      Hybrid
      Verilog
      Cadence
      IoT
      Engineering

    • Doctoral Thesis: Detection and Recovery Mechanisms for Analog Edge AI Hardware (f/m/div)

      Infineon Technologies AG
      Döbeln
      26.02.2025
      Vollzeit
      Supervision
      FPGA
      Customer Success
      Design
      Edge
      Programmiererfahrung
      CAN
      Internet der Dinge
      Mobile App
      Layout
      C++
      Assembler
      Industrial
      Python
      SAFe
      VHDL
      Analyse
      Verilog
      DES
      IoT
      Engineering

    • FPGA Training Instructor

      Plc2 Design Gmbh
      Jahnatal
      06.06.2024
      Vollzeit
      Weiterbildungsmaßnahmen
      Systems Engineering
      DSP
      Data Processing
      ACT!
      CAN
      MS Access
      C++
      Industrial
      Spirit
      Solid
      Make
      HR-Bereich
      Active Directory
      Go
      Linux
      MS Project
      Policy
      Product Owner
      FPGA
      Edge
      Programmiererfahrung
      Embedded Linux
      C-Programmiersprachen
      Teamfähigkeit
      Mobile App
      Flexibilität
      Python
      Logic
      VHDL
      Analyse
      Verilog
      MS Excel
      Engineering

    • Doctoral Thesis: Functional Software Generation (f/m/div)*

      Infineon Technologies AG
      Jahnatal
      06.06.2024
      Vollzeit
      SystemC
      Programmiererfahrung
      DSP
      ACT!
      Rust
      C-Programmiersprachen
      Mobile App
      Open Source
      Assembler
      Industrial
      Python
      VHDL
      Verilog
      Support
      Engineering
      TARGET

    • Werkstudent Software / Hardware / Digital Design (m/w/d)

      Deveritec
      Jahnatal
      06.06.2024
      Vollzeit
      FPGA
      Programmiererfahrung
      Dienstleistungen
      Internet der Dinge
      iOS
      C-Programmiersprachen
      Kotlin
      Teamfähigkeit
      Swift
      Java
      VHDL
      Embedded Software
      Altium Designer
      Verilog
      Software-Implementierung
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